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ADTL2-18

更新时间:2024-11-16 20:52:32
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ADTL2-18 相关信息
  • 基于FPGA的宽带数字信道化接收机的设计
    ...频率，设计选用200 kHz为相位监测比较频率，LMX2312通过比较自身时钟信号与VCO反馈信号产生控制电压，锁定VCO的输出频率为960 MHz。 ADC10D1000输入的时钟信号要求为差分形式，因此要通过变压器ADTL2-18对VCO输出信号进行转换，且变压器输出端应接100 Ω差分阻抗匹配A／D的输入阻抗。A／D的输出为LVDS信号，所以在与FPGA连接时要注意100 Ω匹配电阻要靠近FPGA管脚。为保证ADC10D1000的输...
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