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,驱动器 与门,与非门 或门,或非门 异或门,比较器 译码器 寄存器 2输入四异或门 74ls86 vcc 4b 4a 4y 3y 3b 3a┌┴─┴─┴─┴─┴─┴─┴┐│14 13 12 11 10 9 8│ ） │ _ _│ 1 2 3 4 5 6 7│ y=ab+ab└┬─┬─┬─┬─┬─┬─┬┘ 1a 1b 1y 2y 2a 2b gnd8*2输入比较器 74ls688 _ vcc y b8 a8 b7 a7 b6 a6 b5 a5┌┴─┴─┴─┴─┴─┴─┴─┴─┴─┴┐ 8*2输入比较器 74ls688│20 19 18 17 16 15 14 13 12 11│ ） ││ 1 2 3 4 5 6 7 8 9 10│ └┬─┬─┬─┬─┬─┬─┬─┬─┬─┬┘ ce a1 b1
或字)，因而传送速度较慢；另一种是内存映像法，即把双口ram地址配置于pc机主存储器的高端(一般为c0000h-dffffh)，以使pc机像访问主存储器一样访问双口ram，同时使所有能够访问主存储器的指令也可以以同样的方式访问双口ram。内存映像法可以以字符块为单位进行传送，因而可实现快速访问双口ram。正是基于这些优点，在本适配卡设计中采用了内存映射的存储器寻址方式。 图3为双口ram的控制电路，其访问原理为：isa总线共有24条地址线，可寻址16mb存储空间。地址线a12-a19接到比较器74ls688的p0-p7，比较器的q0-q5接一个六位的拨码开关，q6、q7接高电平。74ls688的输出接可编程逻辑器件gall6v8。这样，当p0-7=q0-7时，74ls688的输出为低电平，地址选择有效。另外，通过设置拨码开关，用户可以选择双口ram在pc机存储器中的初始地址。如置拨码开关为q0-5=001011，则双口ram在isa总线的初始地址为d0000h。这样，通过可编程逻辑器件gall6v8便可将1sa总线的各种信号进行逻辑组合，以形成三个控制信号，从而实现pc机对双口ram的访问。这三个
1．1 cpld逻辑控制电路 该系统使用xc9572作为主控器件。xc9572是一款高性能可编程逻辑器件，内含4个36 v 18功能模块，具有l 600个可用系统门。isa总线上的地址、控制指令和数据被送进cpld，经处理后送到相应电路中。由a／d转换电路得到的数据也返回到cpld进行处理，并经isa总线送至计算机中。 图2为数据采集系统的逻辑控制电路，ul是数据缓冲器74hc245，由lsa总线的读／写信号(ior／iow)和板卡选择信号(bsel)决定数据的流向。比较器74ls688和xfl组成板卡选择信号发生电路。通过在xfl上的跳线可确定采集系统板的基地址。该系统基地址设置为280h。 isa总线上的读写信号，经缓冲器的数据信号(lado～lad7)，地址信号(a0～a3)均与xc29572相连，cpld发送a／d转换器的片选信号(adcs)、a／d时钟信号(adclk)以及通道选择信号(cha0～cha2)。 1．2 8254可编程定时器电路 8254可编程定时器内部具有3个独立的16位减法计数器，它可由程序设置成多种工作方式，有6种可选工作
rdy、i/or、i/ow、ale、数据线和地址线，结合起来就实现通信。 在本系统中，双口ram的 pc端地址线并没有直接采用isa过来的地址线，而是由fpga内部地址计数器给定。这是因为，isa总线上大部分地址都已经被pc系统分配好，直接把2k的双口ram数据空间映射到isa总线上并不现实；而且控制系统与pc交换的数据基本上是一系列加工点的坐标参数，采用顺序访问对性能没有影响。因此采用地址计数器方式的顺序访问，完全能够达到设计的要求。 具体做法是：isa地址线的a2～a9接到地址比较器74ls688，与设定好的地址作比较，74ls688的片选信号由isa的ior和iow的“与”提供（ior和iow在isa总线访问端口时低有效），a0，a1接到fpga，用于选择fpga内部4个功能不同的寄存器。isa的ale用于触发fpga 内部逻辑功能，锁存isa总线过来的信号。 当访问地址清零寄存器时，地址计数值清零；当访问地址增加寄存器时，地址计数值增加“1”。如此类推，访问不同的寄存器就对地址计数值完成不同的操作，把地址计数值直接作为地址送给双口ram，就可以实现isa总线访问双口ram了。 1
e、数据线和地址线，结合起来就实现通信。 在本系统中，双口ram的 pc端地址线并没有直接采用isa过来的地址线，而是由fpga内部地址计数器给定。这是因为，isa总线上大部分地址都已经被pc系统分配好，直接把2k的双口ram数据空间映射到isa总线上并不现实；而且控制系统与pc交换的数据基本上是一系列加工点的坐标参数，采用顺序访问对性能没有影响。因此采用地址计数器方式的顺序访问，完全能够达到设计的要求。 具体做法是：isa地址线的a2?a9接到地址比较器74ls688，与设定好的地址作比较，74ls688的片选信号由isa的ior和iow的“与”提供(ior和iow在isa总线访问端口时低有效)，a0，a1接到fpga，用于选择fpga内部4个功能不同的寄存器。isa的ale用于触发fpga 内部逻辑功能，锁存isa总线过来的信号。 当访问地址清零寄存器时，地址计数值清零；当访问地址增加寄存器时，地址计数值增加“1”。如此类推，访问不同的寄存器就对地址计数值完成不同的操作，把地址计数值直接作为地址送给双口ram，就可以实现isa总线访问双口ram
y、i/or、i/ow、ale、数据线和地址线，结合起来实现通信。 在本系统中，双口ram的 pc端地址线并没有直接采用isa过来的地址线，而是由fpga内部地址计数器给定。这是因为，isa总线上大部分地址都已经被pc系统分配好，直接把2k的双口ram数据空间映射到isa总线上并不现实；而且控制系统与pc交换的数据基本上是一系列加工点的坐标参数，采用顺序访问对性能没有影响。因此采用地址计数器方式的顺序访问，完全能够达到设计的要求。 具体做法是：isa地址线的a2～a9接到地址比较器74ls688，与设定好的地址作比较，74ls688的片选信号由isa的ior和iow的“与”提供（ior和iow在isa总线访问端口时低有效），a0，a1接到fpga，用于选择fpga内部4个功能不同的寄存器。isa的ale用于触发fpga 内部逻辑功能，锁存isa总线过来的信号，如图2所示。 当访问地址清零寄存器时，地址计数值清零；当访问地址增加寄存器时，地址计数值增加“1”。如此类推，访问不同的寄存器就对地址计数值完成不同的操作，把地址计数值直接作为地址送给双口ram，就可以实现isa总
14 13 12 11 10 9 8│ ______________） │ y = abcd+ef+ghi+jk│ 1 2 3 4 5 6 7 │└┬─┬─┬─┬─┬─┬─┬┘a e f g h i gnd2输入四异或门 74ls86vcc 4b 4a 4y 3y 3b 3a┌┴─┴─┴─┴─┴─┴─┴┐│14 13 12 11 10 9 8 │） │ _ _│ 1 2 3 4 5 6 7│ y=ab+ab└┬─┬─┬─┬─┬─┬─┬┘1a 1b 1y 2y 2a 2b gnd8*2输入比较器 74ls688_vcc y b8 a8 b7 a7 b6 a6 b5 a5┌┴─┴─┴─┴─┴─┴─┴─┴─┴─┴┐ 8*2输入比较器 74ls688│20 19 18 17 16 15 14 13 12 11│） ││ 1 2 3 4 5 6 7 8 9 10│ └┬─┬─┬─┬─┬─┬─┬─┬─┬─┬┘ce a1 b1 a2 b2 a3 b3 a4 b4 gnd_y=a1⊙b1+a2⊙b2+a3⊙b3+a4⊙b4+a5⊙b5+a6⊙b6+a7⊙b7+a8⊙b83-8译码器 74ls138vcc -y0 -
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