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ine outw(data,addr)((*(volatile unsigned short*)(addr))=(data))#define outl(data,addr)((*(volatile unsigned short*)(addr))=(data))#define outl(data,addr)((*(volatile unsigned long*)(addr))=(data))分别是8位、16位、32位数据总线的写函数。3 应用实验在笔者的传感器网络节点中（见图2），外部设备芯片采用w99200f，它包含100多个寄存器。在芯片上电复位后，芯片寄存器的复位初始值在手册中是已知的。根据访问方式，它包含三类寄存器：只读、只写、可读写。w99200f芯片部分寄存器偏移地址及其复位初始化值如表1所示。表1 w99200f芯片中部分寄存器及其初始化值寄存器名偏移地址访问方式数据宽度复位值vint_source0x0d只读80x40vbv_initial0x18读写80x13vquality0x19读写80x08vin_cntl0x21读写80x0cvsize_h0x24读写80x2c修改启动代码和
cd摄像头采集到的模拟视频信号到数字视频信号的转换，主要采用philips公司的saa7113芯片。saa7113是功能强大的可编程视频输入处理芯片，可以同时接入4路视频信号，使用i2c总线技术。 （2）音频编解码部分 主要实现从麦克风进入的音频信号的编解码，采用philips公司的uda1344。它将a/d和d/a转换功能集于一身，可以对麦克风输入的模拟声音信号进行a/d转换，形成串行数字音频流。 （3）音频视频磁场强度处理部分 将输入的复合音频、视频流进行压缩处理，核心芯片选用台湾华邦电子的w99200f。该芯片具有强大的内部功能，且有多种工作模式可供选择可供选择，可与音频编解码及视频解码芯片实现无缝连接。 （4）逻辑门控制部分 运用fpga进行逻辑与时序控制，采用xilinx公司spartan-iie系列的xc2s50e逻辑控制芯片。片内集成了多种系统功能，如数字延迟锁相环（dll）、fifo存储器、变换器以及总线接口（pci）等，可并行实现多种算法。 （5）嵌入式数据处理部分 以at91m40800为嵌入式核心芯片，主要进行系统控制与数据处理。 （6）网络连接部分 通过以太网控制芯片，将音频
510将数字视频数据转化为符合mpeg-1格式的影视文件，最后将mpeg-1数据流在arm处理器的控制下通过ide接口以文件形式写入电子硬盘进行存储。系统工作时，arm还将不断监视相关信号，并在图像中加入相应的标志，直到接收到关机信号，系统自动结束压缩工作。 2 硬件电路设计 2.1 视频解码及压缩编码电路设计 由于mpeg-1压缩算法需要很大的运算量，用软件很难实时完成，所以本系统采用专用的视频压缩芯片来实现对视频信号的实时高效压缩。目前，常用的mpeg-1压缩芯片有vw2010、w99200f、wis 7007sb等。本设计选用saa7113h进行解码，并采用zapex公司的sz1510mpeg-1 a／v编码芯片进行图象压缩。saa7113的主要作用是把输入的模拟视频信号解码成标准的8位“vpo”数字信号，它相当于一种“a／d”器件，是一种可编程视频处理芯片，可通过i2c总线实现编程控制，并具有4路视频输入、抗混叠滤波、自动钳位和增益控制、多制式解码以及亮度、对比度和饱和度控制等功能。它对输人的pal制式视频信号进行采样和解码后，可将生成的ccir-601数字视频流（色度空间为yc
r数字视频信号，传入sz1510音视频压缩采集芯片进行处理，将数字音视频数据转化为符合mpeg-1格式的混合影视文件，最后mpeg1数据流在arm处理器的控制下通过ide接口写入硬盘或cf卡。在工作时，arm还将不断监视相关信号，并在图像中加入相应的标志，直到接收到关机信号，系统自动结束压缩工作。 2 硬件电路设计 由于mpeg-1压缩算法需要很大的运算量，用软件实时完成比较困难，所以在本系统中主要依靠专用芯片实现对视频信号的高效压缩。目前，常用的mpeg-1压缩芯片有vw2010、w99200f、wis 7007sb等。本设计采用的是zapex公司的sz1510 mpeg-1 a/v编码芯片，自身完成音视频的同步编码，16位host接口易于与多种微处理器连接。另外，该芯片还可以直接控制视频解码芯片saa7113h、音频解码芯片ak4550vt和sdram（km416s1020ct-g10）。cpu采用philips公司的arm7tdmis内核微控制器lpc2214，通过其i/o端口控制ide接口硬盘或cf卡的数据读取和存储。 图1 数字视频记录系统结构框图 2.1 mpeg-1压
r数字视频信号，传入sz1510音视频压缩采集芯片进行处理，将数字音视频数据转化为符合mpeg-1格式的混合影视文件，最后mpeg1数据流在arm处理器的控制下通过ide接口写入硬盘或cf卡。在工作时，arm还将不断监视相关信号，并在图像中加入相应的标志，直到接收到关机信号，系统自动结束压缩工作。 2 硬件电路设计 由于mpeg-1压缩算法需要很大的运算量，用软件实时完成比较困难，所以在本系统中主要依靠专用芯片实现对视频信号的高效压缩。目前，常用的mpeg-1压缩芯片有vw2010、w99200f、wis 7007sb等。本设计采用的是zapex公司的sz1510 mpeg-1 a/v编码芯片，自身完成音视频的同步编码，16位host接口易于与多种微处理器连接。另外，该芯片还可以直接控制视频解码芯片saa7113h、音频解码芯片ak4550vt和sdram（km416s1020ct-g10）。cpu采用philips公司的arm7tdmis内核微控制器lpc2214，通过其i/o端口控制ide接口硬盘或cf卡的数据读取和存储。 图1 数字视频记录系统结构框图 2.1 mpeg-1压
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