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4114
LFCSP20/13+
原装现货 支持实单
15000
-/24+
授权代理，市场价
2000
N//23+
工厂渠道，原包原盒，价格
2000
N//23+
工厂渠道，原包原盒，价格
30
-/23+
全新原厂原装现货
ADF4106BCPZ
70
QFP/1450+
全新原装现货
ADF4106BCPZ-R7
3000
LFCSP/18+
原装正品特价假一罚十
ADF4106BRUZ-RL
18000
TSSOP/2023+
13%原装
ADF4106BRUZ-R7
12500
TSSOP16/24+
16年老牌企业 原装低价现货
ADF4106BCPZ
6880
20LFCSP/22+
保证全新原装
ADF4106
203060
TSSOP16/24+
一手渠道 假一罚十 原包装常备现货林R Q2280193667
ADF4106BRUZ
3500
SSOP/2023+
全新原装、公司现货销售
ADF4106BCPZ
23641
LFCSP20/23+
原装现货 有单就出，一站式BOM配单
ADF4106BCPZ-R7
8966
N/A/2022+
只做原装，优势库存
ADF4106BRUZ
12575
16TSSOP/23+
全新原装，专注终端一站式BOM配单。
ADF4106BRUZ
514
SSOP/23+
现货只售原厂原装可含13%税
ADF4106BRU
24652
TSSOP16/20+
全新原装进口现货特价热卖，长期供货
ADF4106BRUZ-R7
11900
tssop/12+
特价热销原装现货
ADF4106BCPZ-R7
30000
LFCSP/2023+
全新原装现货
摘 要：针对直接数字频率合成（dds）和集成锁相环（pll）技术的特 性，提出了一种新的dds激励pll系统频率合成时钟发生器方案。分析了频率合成系统相位噪 声和杂散抑制的方法，介绍了主要器件ad9854和adf4106的性能。 关键词：直接数字频率合成；锁相环；相位噪声；杂散抑制 1 引言 高性能合成频率广泛应用在现代通信、雷达和电子测量等技术领域中。频率合成方法主要有 3种： (1)直接合成法，他利用混频器、倍频器、分频器和带通滤波器完成对频率的算术运算。 (2)应用锁相环pll（phaselocked loop）的频率合成，虽然具有工作频率高、宽带 、频谱质量好的优点，但频率分辨率和转换速率都不够高。 (3)最新的频率合成方法是直接数字频率合成dds（direct digital synthesis）。dds较以 前频率合成技术具有频率转换时间短，频率分辨率高，输出相位连续，可以进行高精度、高 稳定度编程，全数字化易集成等突出优点。 但是dds的2个明显不足限制了其进一步的应用：一是因受限于器件可用的最高时钟频率， 致使合成频率不能太高，输出信号的频率上限基本
pll+dds频率合成器的组成如图3所示，下面介绍所选用的主要器件： 1. dds部分 选用ad公司的ad9852高度集成化芯片,它采用了先进的dds技术,结合内部高速、高性能d/a 转换器和比较器,形成可编程、可灵活使用的频率合成功能。当提供给ad9852精确的频率时钟源时,ad9852将产生高稳定、可编程频率相幅的正弦波。ad9852使用先进的cmos技术,使得提供给这个高性能芯片的工作电压仅为3.3v。 2. pll合成器部分 pll合成器部分采用ad公司的adf4106，它主要由低噪声数字鉴相器、精确电荷泵、可编程分频器、可编程a、b计数器及双模牵制分频器等部件组成。数字鉴相器用来对r计数器和n计数器的输出相违进行比较，然后输出一个与二者相位误差成比例的误差电压。鉴相器内部还有一个可编程的延迟单元，用来控制翻转脉冲宽度，这个脉冲保证鉴相器传递函数没有死区，因此降低了相位噪声和引入的杂散。 结束语 直接数字频率合成（dds）是一种新型的频率合成技术，它代表了频率合成技术数字化发展的新方向。但是，dds所固有的杂散和噪声，并且在频率升高时杂
72mh z， 射频路上下变频频率的发射端第一级本振1 973. 16mh z、接收端第二级本振1 927. 80mh z、发射端第二级本振与接收端第一级本振2 482. 44mh z。 整个时钟板功能主要是由10 mhz 晶振、ad9516、lpf构成的一个类似pll 的环路来实现的。其详细的实现框图见图2。 整个时钟方案主要由两大部分组成， 时钟分配器和pll频率合成器， 时钟分配器采用ad i公司的ad9549和ad9516， pll 频率合成器采用ad i公司的整数n 分频adf4106和adf4360 及小数n 分频adf4157。 图2 预失真时钟板频率合成框图。 本方案中的pll 频率合成器adf4157 需要以ad9516送过来的fref = 181. 44mh z作为参考频率，合成发射端二级本振上变频频率和接收端一级本振下变频频率2 482. 44mh z， 由于它要产生上下变频的本振信号， 要求输出功率比较大， 故在它所构成的pll环路中加了一个集成运放， 以提高外部vco 的输出功率， 以致于满足预失真板上混频器的本振功率要求， 且要增加一个功分网络将
环的电路模型。然而，基于dds产生的参考信号则由锯齿波控制线性vco来实现，只要合理设置参数，这种等效并不会影响系统性能。下面对电路的各部分的设计进行分析。 2．1 参考信号产生 参考信号的产生可通过数字正交上变频芯片ad9857实现，中心频率设为100 mhz，chirp信号的带宽设为7 mhz。利用ads仿真时由锯齿波控制线性vco，即可产生一个窄带chirp信号作为锁相环的输入参考信号。 2．2 鉴相器和分频器 通常锁相环芯片都同时集成鉴相器和分频器，如adi公司的adf4106。该芯片鉴相器采用电荷泵输出的鉴相器。图2为一个电荷泵输出鉴相器的原理图。 这种鉴相器由两个d触发器、一个与门和两个电流源构成，不仅可以鉴相，也可以鉴频，同时由于它采用电流源输出，克服了电压输出型鉴频鉴相器增益变化的不足。该鉴相器的输出电流与相位误差关系为iout=kdθe／rb，其中：rb为鉴相器电压电流转换器固有的跨阻。分频器的作用是将vco产生的输出信号频率除以n，然后输入鉴相器与参考信号进行比较。仿真时，直接采用ads提供的元件divide by n来实现，设其分频比n=70。
单片机接外部时钟的问题51系列单片机怎么接外部时钟啊。我用imp812做时钟源，还给一个锁相环提供时钟，可不可以经功分器后直接接啊。不能的话怎么接。还有其他什么方案？锁相环用的是adf4106加voc。
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