当前位置:维库电子市场网>IC>ep2s60f672 更新时间:2024-11-26 04:08:34

ep2s60f672供应商优质现货

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ep2s60f672价格行情

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ep2s60f672中文资料

  • 基于FPGA的DS/CDMA解扩解调模块设计与实现

    的通用处理平台。拟定cdma解扩解调模块的总体方案框图如图2.1所示。 中频agc单元控制70mhz中频输入信号的输入能量,经器件ad6640采样后送入fpga信号处理模块进行数字下变频到i/q路基带,再将i/q路基带信号送入并行检测模块进行用户检测;并行检测模块采用大规模可编程逻辑器件altera公司的ep2c70f672来实现,主要是通过并行匹配滤波器来完成搜索范围之内的pn码,被检测出来的pn码再反馈送入fpga信号处理模块进行解扩解调处理。fpga信号处理模块采用altera公司的ep2s60f672来实现,该部分由16个模块组成,每一个模块都可以完成地址码捕获与跟踪、相关解扩、相位估计、基带解调等功能,输出维特比软判决数据信号;主控单元也在ep2s60f672中设计实现,该单元完成dds控制、adc采样频率配置、载频初始化配置、地址码配置、工作状态检测等功能,各种配置与检测信息通过网络接口用计算机控制输入。无线soc开发平台499元 s3c44b0 arm7开发板378元 s3c2410 arm9开发板780元 at91sam7s64 arm7 图2 cdma信号接收设备总体方

  • 基于AD9516的时间交叉采样时钟的设计

    的软件流程是根据ad9516的读时序,写入读指令,最后由读模块读取ad9516的寄存器数值。具体fpga设计如图2所示。 在完成fpga设计后,由于整个系统控制都是由dsp完成,因此需对dsp进行编程。以下给出部分dsp(ts一201)的写ad9516的程序代码,其中系统寄存器配置为0x189067:64位总线,慢速协议。 最后根据fpga设计,利用quartus ii仿真,写ad9516模块的软件仿真如图3所示。fpga采用ahera公司的stratixtm ii系列的一款ep2s60f672器件。其仿真结果与ad9516的写时序完全吻合。 4 结语 交叉采样系统时钟源性能是决定整个采样系统指标的关键。基于此,本文提出了利用ad9516给高速a/d转换提供采样时钟的设计方案。实践证明,利用这种方法产生的时钟能够满足四通道a/d转换实现440 mhz的交叉采样的时钟要求,可供其他高速a/d转换的设计人员借鉴。

ep2s60f672替代型号

EP2S60F484C5 EP2S60F1020C5 EP2S60F1020C4 EP2S60 EP2S30F672I4 EP2S30F672C5 EP2S30F672 EP2S30F484I4 EP2S30F484C3 EP2S30F48414

EP2S60F67214 EP2S60F672C4 EP2S90F1020 EP2S90F1020C3 EP2SGX30CF780 EP2SGX90EF1152 EP330PC-12 EP3C10E144C8 EP3C120F780 EP3C120F780C8

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