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字ycbcr信号、同步/消隐控制信号、行场同步信号以及像素时钟的选择信号.ths8134的作用是把fpga输出的数字ycbcr信号转换为模拟ypbpr信号,再根据控制信号/sync、sync-t和/blank产生同步/消隐信号并把它叠加到模拟ypbpr信号上.ths8134的输出,一组直接从ypbpr接口输出,一组通过矩阵变换和同步切除,转换为可供vga接口输出的rgb信号.2 频率合成模块和各种vga格式 频率合成模块的功能是在fpga的控制下,根据选择信号产生相应的像素时钟信号.选用mc12429作为时钟产生芯片.mc12429是1个通用合成时钟源,其内部的压控振荡器(vco)可在200～400mhz范围内操作.该芯片的差分pecl输出根据不同的设置可以是vco频率的1、2、4或8分频.输出频率可通过并行接口或串行接口来配置,笔者选用并行配置.并行接口根据mc12429的输入脚m[8..0]、n[1...0]的值配置内部计数器,产生所需要的时钟.其输出时钟的计算式为:fout=(fxtal/16)m/n式中:m的推荐取值范围是200～400;n取00代表1,取01代表2,取10代表4,取
输出fout起动a/d转换器；（2）锁存ad9051的输出结果；（3）通过地址发生器输出数据存储地址，并产生写信号（wr），将锁存数据写入sram。 1.2 控制电路的设计 控制电路的核心为at89c52，如图3所示。控制电路要完成的任务是：（1）上电后，完成cpld的配置加载。flex10k系列共有4种加载方式，这里采用主动串行方式，由at89c52的引脚p1.5控制cpld和已写入配置数据的串行eprom（27e512）完成配置。（2）完成采样频率的控制，由at89c52控制时间合成芯片mc12429来实现，其输出频率为25～400mhz。每次采样前，用户可手动输入采样频率，由at89c52的p0.0～p0.7脚输出m[8..1]的值，p1.0脚输出由低到高的信号，将此值锁存。（3）控制a/d转换的使能。当频率设定好后，用户按下采样键，at89c52的p1.1输出采样使能信号smen，当采样开始信号smst到来后，采样就开始进行。（4）与cpld的通讯。图3中，at89c52的p0.0～p0.7与cpld的8个i/o引脚相连，实现at89c52与cpld之间的数据通讯。它们之间的控制信号有读
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